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Ein ereignisgetriebener Ansatz zum Rapid Prototyping von embedded-control-Systemen

Fachliche Zuordnung Rechnerarchitektur, eingebettete und massiv parallele Systeme
Förderung Förderung von 1996 bis 2003
Projektkennung Deutsche Forschungsgemeinschaft (DFG) - Projektnummer 5275371
 
Im Rahmen dieses Projektes wird ein Konzept für ein RapidPrototyping Testbett für solche embedded-control Applikationen entwickelt, deren zeitkritische Pfade in der Reaktion auf asynchron auftretende Ereignisse liegen. Ein abgestuftes Architekturkonzept führt dabei in meheren Ausbaustufen zu einer Leistungsklasse, welche die im Rahmenantrag genannten Kenndaten überdeckt. Zentrale Architekturmerkmale sind die vollständige Übertragung der Prozeßauswahl in Abhängigkeit asynchron eintreffender Events auf eine im Prototyp durch FPGAs realisierte Steuerungskomponente, die Verwendung von multi-threaded RISCProzessoren, sowie eine modulare Erweiterbarkeit solcher Boards. Die im Vorhaben geplante Testumgebung unterstützt eine weitestgehend automatische Umsetzung von STATEMATE-Spezifikationen und durch Zeitdiagrammen festgelegten Anforderungsdefinitionen auf dieses Testbett. Insbesondere wird ein Synthesewerkzeug entwickelt, das eine automatische Umsetzung von durch Zeitdiagrammen spezifizierten Realzeitanforderungen erlaubt. Ebenso werden automatisch Kommunikations- und Synchronisationsprotokolle zur Ausführung des generierten Codes auf dem Testbett erzeugt und die durch die Entwickler vorgenommenen Allokations- und Partitionierungsentscheidungen sowohl im Hinblick auf die Berücksichtigung die im Modell enthaltenen Kommunikationsstruktur als auch auf die Einhaltung von Zeitschranken hin analysiert.
DFG-Verfahren Schwerpunktprogramme
 
 

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