Direkt zum Inhalt springen Direkt zu Textvergrößerung und Kontrast springen

Detailseite

Institution

Druckansicht

Universität Siegen
Department Elektrotechnik und Informatik
Research Group Digital Integrated Systems

Adresse Hölderlinstraße 3
57068 Siegen
Deutschland

57068 Siegen

Projekte

Sachbeihilfen
- laufende Projekte
  - Design-Verschleierung mit sequenziellem Timing gegen Reverse-Engineering
    (Antragsteller Li, Bing ; Schlichtmann, Ulf ; Sigl, Georg )
  - Effiziente und präzise Timing-Analyse integrierter Schaltungen mit Methoden des maschinellen Lernens
    (Antragsteller Schlichtmann, Ulf )
  - Erforschung effizienter und robuster optischer Beschleuniger für neuronale Netze
    (Antragsteller Schlichtmann, Ulf )
  - Verbesserung der Zuverlässigkeit und Robustheit von RRAM-basiertem neuromorphen Computing
    (Antragstellerinnen / Antragsteller Li, Bing ; Schlichtmann, Ulf ; Zhang, Li )

© 2024 DFG Kontakt / Impressum / Datenschutz